"华为杯"第五届中国研究生创"芯"大赛参赛邀请函点击链接下载http://cpipc.acge.org.cn/sysFile/downFile.do?fileId=8417b2eea8444a65b303507ee5fdb41c"华为杯"第五届中国研究生创"芯"大赛参赛说明点击链接下载http://cpipc.acge.org.cn/sysFile/downFile.do?fileId=26e4b7844175479dace68f656e5fa03c"华为杯"第五届中国研究生创"芯"大赛PPT模版点击链接下载http://cpipc.acge.org.cn/sysFile/downFile.do?fileId=cd14bf1fff9f4893b566f108fdecba34"华为杯"第五届中国研究生创"芯"大赛成果清单Excel模版点击链接下载http://cpipc.acge.org.cn/sysFile/downFile.do?fileId=89e255c29cc84acaacd912c9f6fba94d"华为杯"第五届中国研究生创"芯"大赛海报点击链接下载http://cpipc.acge.org.cn/sysFile/downFile.do?fileId=30d8c021db1f43d2ae3c7f5b4d1e4362华为企业命题doc文档点击链接下载http://cpipc.acge.org.cn/sysFile/downFile.do?fileId=ded10d8a7e964fc48c2ef46d201d6a9f华为企业命题专项奖：特等奖两队，每队奖金10000元+10000元华为产品；一等奖五队，每队奖金10000元；二等奖十二队，每队奖金5000元。格科微企业命题doc文档点击链接下载http://cpipc.acge.org.cn/sysFile/downFile.do?fileId=52b3539603f24e8188e09eabb4020855格科微企业命题专项奖：一等奖两队，奖金10000元；二等奖五队，奖金5000元。新思科技企业命题doc文档点击链接下载http://cpipc.acge.org.cn/sysFile/downFile.do?fileId=2224378c266047bfa5e03b9158999051新思科技企业命题专项奖：一等奖一名，奖金人民币10000元；二等奖三名，奖金各人民币5000元。Cadence企业命题doc文档点击链接下载http://cpipc.acge.org.cn/sysFile/downFile.do?fileId=5a3f02459e47403e96bf8df9d5278df5Cadence企业命题专项奖：一等奖一队，奖金10000元；二等奖三队，奖金5000元。日月光企业命题doc文档点击链接下载http://cpipc.acge.org.cn/sysFile/downFile.do?fileId=b0878a1bbbd2485fa27207c2bf64b997日月光Sip专项奖：一等奖一队，奖金10000元；二等奖三队，奖金各5000元。艾为电子企业命题doc文档点击链接下载http://cpipc.acge.org.cn/sysFile/downFile.do?fileId=e66b055aeeee4038a0efc9597c300828艾为电子企业命题专项奖：一等奖两队，奖金10000元；二等奖四队，奖金各5000元。泰瑞达企业命题doc文档点击链接下载http://cpipc.acge.org.cn/sysFile/downFile.do?fileId=bbda4d3ba51447fda4beeb45d9310187泰瑞达企业命题专项奖：一等奖一队，奖金10,000元；二等奖三队，奖金各5,000元。华大九天企业命题doc文档点击链接下载http://cpipc.acge.org.cn/sysFile/downFile.do?fileId=b4ae74fab37043f6bc12d44efc42506e华大九天企业命题专项奖：一等奖两队，奖金10000元；二等奖四队，奖金5000元。京微齐力企业命题doc文档点击链接下载http://cpipc.acge.org.cn/sysFile/downFile.do?fileId=8b6c9c30237746769f0d2e17f1294c3d京微齐力企业命题专项奖：一等奖一队，奖金10000元；二等奖三队，奖金5000元。极海半导体企业命题doc文档点击链接下载http://cpipc.acge.org.cn/sysFile/downFile.do?fileId=5f46942667714c71b20ba0ed99aa8313极海半导体企业命题专项奖：一等奖两队，奖金各10,000元；二等奖四队，奖金各5,000元。平头哥企业命题doc文档点击链接下载http://cpipc.acge.org.cn/sysFile/downFile.do?fileId=4b36f05c9eac4590a9799b23f8a4197f平头哥企业命题专项奖：一等奖一队，奖金10000元；二等奖三队，奖金各5000元。

一、报名流程总览二、账号分类1.组委会账号：进行二级审核。2.参赛单位管理员账号：审核本单位报名信息。3.队长账号：申报资料的主账户，可修改队伍信息，提交作品。4.老师及队员账号：同意邀请后只能修改个人资料。三、报名页面指南参赛学生及指导老师在报名前需先注册相应帐号。由队长发起组队，选择赛题，并邀请队员及指导老师，队员及指导老师将收到短信通知，并至报名系统接受邀请，全队在报名系统中接受邀请后，队长可提交报名。参赛单位管理员将审核报名信息，审核通过后方可提交初赛作品。1.账户注册教师账户注册：队长及队员账户注册：2.队长组队并提交作品注意：发起组队需由队长完成，队员及指导老师只需通过组队邀请，请勿发起组队，否则将导致系统混乱。建议使用Chrome浏览器、360浏览器或IE浏览器。队长登录系统并选择相应赛事（创“芯”大赛），点击命题后可看到具体赛题要求，赛题选定后不可修改：确认队长个人信息：填写队伍信息：邀请团队成员：邀请团队成员需要输入成员手机号码及姓名，确认输入无误后队员及指导老师界面可收到邀请消息队员及指导老师界面可在【我的赛事】功能页面中选择接受邀请：队员及老师接受邀请后，队长登录系统确认无误后进入【我的赛事】功能进行提交报名操作并提交报名：待资格审核通过后，队长可提交初赛作品：至此，报名及初赛作品提交流程结束。

一、时间及地点报名启动时间：2022年4月1日报名截止时间：2022年6月20日初赛作品提交截止时间：2022年6月24日决赛时间：2022年7月29日-8月1日决赛地点：浙江大学杭州国际科创中心二、参赛办法1.中国大陆、港澳台地区在读研究生（硕士生和博士生，含留学生）和已获得研究生入学资格的大四本科生（需提供学校保研、录取证明）及国外高校在读研究生均可参赛。2.以参赛队为基本报名单位，每个参赛队由两至三名学生组成。每个参赛队可选指导教师一名或两名，设置队长一名。每位指导教师至多指导三个参赛队，每位参赛队员只能加入一个参赛队。3.大赛官网：https://cpipc.acge.org.cn/cw/hp/10。参赛队在大赛官网上注册、完善报名信息、组队。参赛队所在研究生培养单位进行资格审核后，参赛队在官网上提交参赛作品。4.在初赛阶段，参赛队可以选择自主命题，也可以选择企业命题。对于选择企业公开命题的参赛队，其作品将由企业进行评审。企业公开命题的要求详见官网。5.报名截止日期为6月20日，作品上传截止日期为6月24日。三、作品要求1.参赛作品面向集成电路设计方向、半导体器件与工艺方向与EDA算法与工具设计方向，可以结合研究课题，提交相关的创意、创新或创业作品，具体方向与细分领域如下：集成电路设计方向细分领域：模拟、数据转换器、数字系统与电路、图像MEMS医疗显示等接口、机器学习与人工智能、存储、电源管理、射频技术与无线系统、有线传输、前沿领域与交叉学科。半导体器件与工艺方向细分领域：先进逻辑器件、新兴电子器件、存储器、射频器件、光电子器件、功率器件、传感器、MEMS及生物电子器件。EDA算法与工具设计方向不再进行领域细分。2.参赛作品所属细分领域可以是一到两个，参赛队认为作品涉及除报名题目外的其他领域，可在作品提交时具体标注。3.参赛作品为带语音讲解的PPT和附件。附件包括但不限于参赛团队照片、必要的技术文档、样机照片等。创“芯”大赛不要求参赛队伍提交实物。4.PPT是初赛评审的主要依据，包括但不限于应用背景、设计原理、创新创意、功能/性能演示等内容，PPT必须提前录制语音讲解，并可以动画、视频等形式展示，播放时间不超过8分钟。5.参赛团队照片2张，其中全体成员（包括指导教师）合影1张，全体成员在参赛单位标志物前合影1张，单个图片大小不超过2MB。6.将PPT和附件打包在一个文件夹中并压缩，命名为“参赛单位-参赛队-作品名称-细分领域1（必选）-细分领域2（可选）”并提交至大赛官网。7.参赛队伍需将作品成果按照大赛规定的格式提供成果表格（包括：论文、专利、学术奖项），如参赛队伍所提交成果中含有他人成果（三位参赛队员名字均不在作者名单中），即视为审查不通过，按0分记。成果为学术性成果或者奖励，学生参与的项目不能算做成果。8、曾在往届创“芯”大赛中获得过二等奖及以上奖项的队伍，需在作品文件中标明获奖成果与获奖后新完成的工作。参赛队伍在其他赛事上获奖的队伍也需标注所获奖项。9.鉴于创“芯”大赛作品的特点，需要保密的内容不得在作品设计PPT和附件中体现。10.不限制参赛作品所使用工具的品牌，型号和版本，由参赛队自行选择，所使用软硬件工具的品牌不影响竞赛成绩。五、评审办法1.创“芯”大赛分为两级评审：初赛评审和决赛评审。初赛评审采用网络或会议评审的方式进行。决赛为现场赛，采用答题、答辩及竞演相结合的方式进行。2.初赛评审方式不要求参赛队员到达评审现场，评委通过参赛作品的电子文档进行评审。如有需要，评委可要求参赛队员通过QQ、微信等通讯工具进行视频、语音远程答辩，以求对参赛队和参赛作品充分了解，做出合理的评审决定。3.创“芯”大赛决赛包括三个环节：答题、答辩、竞演。4.答题环节。该环节由基础题及上机设计两部分组成。参赛队的每位成员须独立完成基础题，其平均分作为参赛队的基础题成绩；上机设计题分为集成电路设计类、半导体器件与工艺类及EDA算法与工具设计类，具体题目设置详见决赛通知，参赛队任选其中一个方向并集体完成。此环节的综合成绩排名前50名的参赛队伍晋级答辩环节，其他参赛队伍不参加答辩环节。5.答辩环节。所有晋级的参赛队参加答辩环节，答辩内容为初赛阶段提交的参赛作品的现场演讲，并回答评委的提问。选取前15个队伍参加竞演环节。6.竞演环节：每个参赛队进行路演，并回答评委问题，由评委及现场观众共同打分，得出最终名次。前3名为本届创“芯”之星荣誉的获得者。六、奖项设置和奖励办法1.创“芯”大赛决赛设团队一等奖、二等奖、三等奖，优秀指导教师奖，优秀组织奖等奖项。2.团队一等奖15名，前三名队伍获得“创芯之星”荣誉称号，奖金5万元，获奖证书、奖杯，其余队伍获得奖金2万元，获奖证书；团队二等奖35名，奖金8千元，获奖证书；团队三等奖若干名，获奖证书；最佳指导教师奖若干名，获奖证书；优秀组织奖若干名，获奖证书；3.企业命题包括华为企业命题、格科微企业命题、新思科技企业命题、Cadence企业命题、日月光企业命题、艾为电子企业命题、泰瑞达企业命题、华大九天企业命题、京微齐力企业命题、极海半导体企业命题、平头哥企业命题共十一项。企业命题专项奖设立如下：华为企业命题专项奖：特等奖两队，每队奖金10000元+10000元华为产品；一等奖五队，每队奖金10000元；二等奖十二队，每队奖金5000元。格科微企业命题专项奖：一等奖两队，奖金各10000元；二等奖五队，奖金各5000元。新思科技企业命题专项奖：一等奖一队，奖金10000元；二等奖三名，奖金各5000元。Cadence企业命题专项奖：一等奖一队，奖金10000元；二等奖三队，奖金各5000元。日月光Sip专项奖：一等奖一队，奖金10000元；二等奖三队，奖金各5000元。艾为电子企业命题专项奖：一等奖两队，奖金各10000元；二等奖四队，奖金各5000元。泰瑞达企业命题专项奖：一等奖一队，奖金10000元；二等奖三队，奖金各5000元。华大九天企业命题专项奖：一等奖两队，奖金各10000元；二等奖四队，奖金各5000元。京微齐力企业命题专项奖：一等奖一队，奖金10000元；二等奖三队，奖金各5000元。极海半导体企业命题专项奖：一等奖两队，奖金各10,000元；二等奖四队，奖金各5,000元。平头哥企业命题专项奖：一等奖一队，奖金10000元；二等奖三队，奖金各5000元。4.决赛各个奖项均获得由组委会统一颁发荣誉证书。七、其他1.决赛期间，参赛队餐费、住宿费由组委会负责，差旅费等其它费用自理。2.不能组队参加本届竞赛的单位可以派员进行观摩，每个单位可派1-2名代表，观摩人员交通费和住宿费用自理，承办单位将提供有关方便。具体观摩方案请关注后续通知。3.进入决赛的参赛队必须自带电脑（及网线转接口）。决赛现场将为每个参赛队伍提供3个标准有线网络接口，可连接至大赛服务器。大赛服务器所需接口软件及服务器内安装的软件列表将于决赛前提供，请关注后续通知。4.根据新冠病毒疫情防控情况和教育部有关要求，结合大赛评审的实际需要，部分赛事时间节点可能会产生变化，具体时间调整另行通知，相关事宜详见大赛官方网站。5.大赛解释权归大赛组委会。八、大赛组委会联系方式秘书处联系人：张逸轩联系电话：0592-5776165；17606905288邮件地址：cpicic@163.com单位：清华海峡研究院承办单位联系人：徐晟联系电话：13777889274邮箱：shengxu@zju.edu.cn单位：浙江大学杭州国际科创中心

器件模型是链接集成电路设计与制造的重要桥梁，不仅支撑着高端芯片的精准仿真与设计实现，也是集成电路制造企业立本的“生命线”。建立器件模型及实现精准的模型参数提取是产业始终致力和追求的目标。随着集成电路工艺节点的持续推进，器件愈加复杂的物理效应及特性需要通过更复杂的直流及射频模型进行表征；新型器件的不断涌现也提出建立新模型并不断完善的要求。因此，以半导体产业标准和规范，建立器件模型，达成误差要求的精准参数提取，具有重要的理论意义和产业价值。华大九天专项奖设置：一等奖两队，奖金一万元二等奖四队，奖金五千元企业命题交流群赛题一硅基工艺MOSFET器件直流或射频模型描述及要求器件直流特性模型或射频特性模型二选一。可基于成熟高压器件或者先进逻辑工艺器件建模。直流模型必须包括器件基本IV、CV曲线以及器件工艺节点的尺寸缩放和基本二阶效应；射频模型必须包含器件S/Y参数曲线以及器件工艺节点的尺寸缩放和基本二阶效应，RF频率范围≥20GHz。用于建模的MOS器件特性数据可来源于器件实测值或TCAD仿真结果，不限定器件制备工艺和节点，但需清晰叙述器件制备或设计所采用工艺、器件测试方案或仿真条件。结合器件结构及工艺，对器件物理特性进行分析，给出所选模型的拓扑结构，并对模型参数提取流程做介绍。除上述1-4提出的基本要求外，完成器件更多、更复杂二阶效应建模，且给出该效应的物理机制、测试或仿真方法、建模方法，将作为得分项。提供建模后的模型文件。得分点给出器件物理结构和基本工艺，完成性能分析。（15分）根据器件特性，提出建模所需的测试或仿真方法。（15分）给出模型的拓扑结构，提出模型提取流程，完成模型参数提取并建立模型文件。（30分）给出模型与数据的误差对比，直流模型的精度越高或RF模型的频率越高，且包含二阶效应越多，得分越高。(30分)总结所建立模型的优缺点，并提出未来可提升的方向。(10分)赛题二化合物工艺HEMT器件直流建模或射频建模描述及要求器件直流特性模型或射频特性模型二选一。直流模型必须包括器件基本IV、CV曲线以及基本二阶效应；射频模型必须包含器件S/Y参数曲线以及基本二阶效应，RF频率范围≥20GHz。用于建模的器件特性数据可来源于器件实测值或TCAD仿真结果，不限定器件制备工艺，但需清晰叙述器件制备或设计所采用工艺、器件测试方案或仿真条件。结合器件结构及工艺，对器件物理特性进行分析，给出所选模型的拓扑结构，并对模型参数提取流程做介绍。除上述1-4提出的基本要求外，完成器件更多、更复杂二阶效应建模，且给出该效应的物理机制、测试或仿真方法、建模方法，将作为得分项。提供建模后的模型文件。得分点给出器件物理结构和基本工艺，完成性能分析。（15分）根据器件特性，提出建模所需的测试或仿真方法。（15分）给出模型的拓扑结构，提出模型提取流程，完成模型参数提取并建立模型文件。（30分）给出模型与数据的误差对比，直流模型的精度越高或RF模型的频率越高，且包含二阶效应越多，得分越高。(30分)总结所建立模型的优缺点，并提出未来可提升的方向。(10分)参考文献http://bsim.berkeley.edu/Y.S.Chauhan,D.D.Lu,V.Sriramkumar,S.Khandelwal,J.P.Duarte,N.Payvadosi,A.Niknejad,andC.Hu,“FinFETModelingforICSimulationandDesign:UsingtheBSIM-CMGStandard,”AcademicPress,298pages,2015.W.Liu.C.Hu,“BSIM4andMOSFETModelingforICSimulation,”WorldScientificPublishing,Singapore,414pages,2011.P.Kushwaha,H.Agarwal,Y.-K.Lin,M.-Y.Kao,J.-P.Duarte,H.-L.Chang,W.Wong,J.Fan,Xiayu,Y.S.Chauhan,S.Salahuddin,andC.Hu,"ModelingofadvancedRFbulkFinFETs,"IEEEElectronDeviceLett.,vol.39,no.6,pp.791-794,Jun.2018.GhoshS,AhsanSA,DasguptaA,etal.GaNHEMTmodelingforpowerandRFapplicationsusingASM-HEMT[C]InternationalConferenceonEmergingElectronics.IEEE,2017.

艾为电子企业命题专项奖设置一等奖两队，奖金10000元二等奖四队，奖金5000元艾为电子企业命题答疑邮箱icic@awinic.com赛题一适用于5Gn77频段的可变增益低噪声放大器赛题背景随着5G技术的大规模商用，基于5G网络的手机型号层出不穷。作为科技行业的整体趋势，5G已毫无疑问成为“兵家必争之地”。2019年10月31日，我国三大运营商中国移动、中国联通和中国电信公布了5G商用套餐，并于11月1日正式上线了5G套餐资费，这也标志着我国正式进入了5G商用时代。其中中国移动拥有n41和n79两个5G频段；中国电信和中国联通则共享n78频段：中国电信采用3400MHz-3500MHz，中国联通则是3500MHz-3600MHz；而日本和欧洲运营商所采用的主流频段为n77频段。对于移动设备而言，所兼容频段越多，其使用范围越广。为满足对国外主流n77频段的兼容需求，现提出适用于5Gn77频段的可变增益低噪声放大器题目。描述及要求请按照设计指标，设计如下结构带有前置滤波器的可变增益低噪声放大器，其中滤波器和LNA都需要用硅基工艺实现，滤波器不推荐用分立器件实现。题目实现方式方式建议如下：1)两颗Die封装集成的方式，两颗Die用金丝键合的方式链接，这里设定两颗Die之间的键合金丝电感值为0.5n,Q为20。2)整个题目可以用一颗Die实现，即为需要在一颗Die上面实现Filter和LNA的集成。图1.带有前置滤波器的可变增益低噪声放大器设计指标：1.工作频带：3.3~4.2GHz2.工艺：不限（推荐90nm、65nm）3.电源电压：1.8V4.稳定性系数K：>1(0.1~10GHz)5.输入回波损耗S11:<=-8dB6.输出回波损耗S22：<=-10dB7.封装：不考虑封装设计，如需用到键合线等可用理想模型替代。8.不同增益档位下，功耗、噪声、输入1dB压缩点、输入3阶交调点指标如下：G2模式ParameterMinTypMaxUnitsTestConditionGain1617.519dB-40~+85℃/TT/1.8VICQ/1213mA-40~+85℃/TT/1.8VNF/2.83.1dB-40~+85℃/TT/1.8VInputP1dB-15-13/dBm-40~+85℃/TT/1.8VIIP3-6-5/dBm-40~+85℃/TT/1.8VPin1=Pin2=-52dBmF1=3800MHz,F2=3801MHzG1模式ParameterMinTypMaxUnitsTestConditionGain1.534.5dB-40~+85℃/TT/1.8VICQ/67mA-40~+85℃/TT/1.8VNF/55.5dB-40~+85℃/TT/1.8VInputP1dB-20/dBm-40~+85℃/TT/1.8VIIP346/dBm-40~+85℃/TT/1.8VPin1=Pin2=-34dBmF1=3800MHz,F2=3801MHzG0模式ParameterMinTypMaxUnitsTestConditionGain-6.5-8-9.5dB-40~+85℃/TT/1.8VICQ/11.5mA-40~+85℃/TT/1.8VNF/89dB-40~+85℃/TT/1.8VInputP1dB57/dBm-40~+85℃/TT/1.8VIIP31315/dBm-40~+85℃/TT/1.8VPin1=Pin2=-19dBmF1=3800MHz,F2=3801MHz软硬件开发平台硬件平台：无软件平台：电路仿真工具：Spectre，ADS，Momentum，HFSS等；作品提交要求1.需提供完整电路分析设计报告：ⅰ电路结构分析ii电路参数指标分析及设计iii电路后仿结果（路场仿真）2.作品讲解及展示PPT。3.作品展示视频。视频时长不超过10分钟，文件大小100MB以内。评审点指标评审标准设计完整性(40分)是否包含所有要求模块，该模块是否可以完成对应功能：1)原理图：LNA、模拟电路、滤波器（15分）LNA、模拟电路和滤波器联仿：前仿在指标范围内，可得相关项满分。结果误差小于30%，得相关项一半。误差大于30%，得0分。G2仿真结果G1仿真结果G0仿真结果9分3分3分2)EM：滤波器和LNA联合EM仿真建立（20分）EM版图按照建模后版图大小、信号流走向作为考核标准。联仿bench按照建模的准确性判断。滤波器EM版图6分LNAEM版图7分联仿bench7分3)Layout：版图布局(5分)性能(30分)作品设计性能是否满足指标要求：后仿结果三档指标都满足要求得5分，只有G2/G1满足得4分，G2/G0档满足得3分，G1/G0或者只有G2档满足得2分,只有G2/G1/G0中任意一项满足得1分，都不满足得0分。1)增益：5分2)噪声系数：5分3)输入输出回波损耗：5分4)输入P1dB：5分5)IIP3：5分6)ICQ：5分除以上评分标准外，对于上面六个评分指标可用以下FoMAW值来作为评估标准，FoM值越高，说明性能越好。其中norm值为设计指标中的Typical值，所计算FoMAW需体现在设计文档与汇报PPT中（包含G2/G1/G0三个档位）：创新性(20分)作品是否在设计中使用较为新颖设计或者使用较为新颖建模方式，使其模型更符合仿真结果可展示性(10分)作品展示与汇报PPT重点突出、条理清晰赛题二高压高带宽DC-DCBOOST设计赛题背景随着电子技术的不断发展，便携式智能设备的功能越来越丰富，对于智能设备的供电电源DC-DCBOOST供电能力，负载跟踪响应速度，功耗和效率提出了较高的要求，另外，在多电源应用中，为了防止电池系统异常，对于BOOST峰值限流电流精度提出了更高的要求，本课题着重设计高带宽(快速负载跟踪响应)、高精度峰值限流、高效BOOST。描述及要求电路：高压高带宽DC-DCBOOST工艺：不限，推荐0.18umBCD5V/16V工艺要求：输入电压VIN：3~5.5V（TYP=4.2V）输出电压VOUT：8~16V（TYP=12V）环路带宽BWClose-Loop：≥100KHz（传递函数/建模仿真）负载响应：VOUT瞬态跟随响应（VREF输入20Hz~15KHz正弦信号，需呈现20Hz、1kHz、15kHz的仿真结果）负载响应指标示意图瞬态响应过冲VOUT,overshoot：≤400mV（动态负载，1us内0A-1A跳变）峰值限流IPEAK（OCP）：7A±sigma%，sigma≤10全负载范围高效率η≥81%，η_MAX≥92%(ILOAD=10m~1A)静态功耗IQ：≤20mA驱动能力ILOAD：≥1A（输入电压≥3.3V）时钟频率：≥2MHz电感L：1uH电容CBST：10uF（加入ESR，40mOhm）Temp：-40~120deg（TYP=55deg）软硬件开发平台硬件平台：无软件平台：电路仿真工具：ModelSim,VCS,Spectre等；建模工具：MATLAB，Python，Simplis等作品提交要求高压高带宽DC-DCBOOST需提供完整电路分析设计报告：ⅰ电路结构分析ii电路参数指标分析及设计iii电路仿真结果作品讲解及展示PPT。作品展示视频。视频时长不超过10分钟，文件大小100MB以内。评审点指标评审标准设计完整性(40分)1）系统建模（15分）：包括建模思路、建模结果等，若建模结果准确度高，则评分相应增加。2）电路完整性（15分）：要求：电路功能正常，至少包括BOOST电路（设计文档与汇报PPT中需明显体现Power管尺寸）；Bias和时钟可以采用理想源，也可以自行搭建Bias、时钟电路；电路完整性越高（包括Bias电路+时钟电路+BOOST电路），得分会相应提高。3）仿真结果完整性（10分）：仿真指标尽可能全，题干要求的指标项必须有仿真结果；尽可能覆盖多的仿真条件，包含PVT等。性能（30分）除以上单项指标考量外，需整体考虑带宽、效率、峰值电流偏差、输入电压下限、静态功耗五项指标，整体性能计算公式如下，其中norm值为设计指标中参考值，所计算FoMAW需体现在设计文档与汇报PPT中：创新性（20分）作品是否在设计中使用较为新颖设计或者使用较为新颖建模方式，使其模型更符合仿真结果。可展示性（10分）作品展示与汇报PPT重点突出、条理清晰。附加项（20分）除以上百分制基本要求外，对版图设计部分将额外给予附加分值：1）若能提交完整版图以及后仿结果，则给予额外加分；（10分）2）若后仿结果能满足题干要求，则本项得分会更高。（10分）参考文献UndertheHoodofaDC/DCBoostConverterBrianT.Lynch；DC_DC开关变换器的建模分析与研究欧阳长莲南京航空航天大学。

格科微电子企业命题专项奖设置一等奖两队，奖金10000元；二等奖五队，奖金5000元。赛题一极暗环境下的视频降噪算法赛题背景随着智能手机等便携设备的飞速发展，个人照片及视频的数量在大幅度的增长，摄像头的应用场景也越来越复杂。在海量的照片及视频中，存在大量的暗光场景，图像的可见度很低，图像质量并不能满足用户的要求。为解决以上问题，多种暗光图像增强技术已经被提出。但是现有的暗光图像增强技术在增强的同时，不可避免的引入各种不自然的缺陷，例如过分夸张的细节或颜色失真等，或者算法过于复杂，处理时间太长，影响用户体验。本课题旨在针对智能手机摄像头模组在环境亮度<2Lux的极暗环境下进行拍照及视频录制时，采取硬件化的图像处理算法，显著提升照片及视频的信噪比，同时避免引入过多的不自然缺陷，提升用户体验，增加产品竞争力。课题内容及要求任务1：完成一个适用于极暗环境（<2lux）的静态图片降噪算法设计（算法类型不限，如基于传统CV或基于AI）；任务2：完成一个适用于极暗环境（<2lux）的动态视频降噪算法设计（算法类型不限，如基于传统CV或基于AI）；任务3：使用硬件描述语言对算法进行定点化实现，并给出相应硬件开销（或PPA估算）及相比于软件算法的性能损失；备注算法输入为课题提供的包含原始RAW的视频图像帧序列，输出为经降噪算法处理后的RAW或RGB序列；算法不能完全使用现有开源算法；若基于开源算法改进，PSNR指标改进量需大于1.5dB，并列出主要改进项；算法不能调用算法过程不明确的模块或函数；若采用AI算法，提供的测试集数据不能参与模型训练；软件算法实现的编程语言为C、C++、Matlab或Python；硬件算法实现语言为Verilog或VHDL；评审得分点任务1：静态图片采用测试集PSNR均值（85%权重）及SSIM均值（15%权重）两个指标综合考量（百分制）；任务2：视频输出结果采用专家从噪声滤除、细节保持及颜色恢复等方面进行主观评测（百分制）；任务3：同等工艺及时序约束下，面积越小得分越高（百分制）；最终得分权重占比：任务1(45%)+任务2(40%)+任务3(15%)；课题目标完成从算法调研到算法实现及验证的全部过程，完成算法描述文档；能够针对课题中遇到的问题，合作思考解决，算法有一定的创新之处。课题输出算法相关的原始代码及详细的算法描述文档；算法仿真结果（图片、视频等，任务1及任务2）、客观指标（任务1）及硬件实现报告（开销及性能损失评估等，任务3）；设计中的问题解决与团队合作过程的心得小结。赛题二快速稳定、低纹波稳压电路设计赛题背景消费电子芯片中，一些模块常需要被高于电源电压的高压驱动。综合考量效率、噪声、成本等因素，相比于传统的DC-DC转换电路，电荷泵（chargepump）作为传统的升降压电源转换电路，有很大的优势。因此，电荷泵在各种消费类电子芯片中，有着广泛的应用。一般地，电荷泵作为芯片内部模块电源，当负载跳变的时传统的稳压电荷泵的输出电压会有较大的抖动，且恢复时间跟工作的时钟频率有关，提高时钟频率会减小恢复时间，但是势必会增加系统的功耗；另一方面，与DC-DC开关电源类似，开关电源的噪声会降低具体的负载产生电路的SNR等性能，同样地，提高时钟频率会减小纹波，但是会增加功耗。传统的解决方法是采用片外电容，能较好的满足负载跳变时快速恢复和低纹波的需求。但考虑到系统的应用成本，无片外电容、电感是更理想的方案，因此，快速稳定和低纹波设计成为急需解决的难题。课题内容及要求完成无片外电感电容稳压电路的原理图和版图设计，片内可用电容<100pF；电源电压3.3V，输出电压可编程3V~6V；平均负载电流100uA，负载电容5pF。功耗<3.3mW。外部可供时钟频率10MHz~60MHz。A:输出电压纹波<1mV；B:负载电容受干扰有-1V跳变时，输出电压稳定在0.1%内时间<10ns。（TT工艺角仿真结果）评审得分点完成课题内容及要求1,2,3A得70分；完成课题内容及要求1,2,3B得80分；完成课题内容及要求1,2,3A和3B得分100；同时完成3A和3B指标前提下，3A和3B单项指标最优+5分，功耗最低+5分，面积最优+5分，效率最高+5分；未完成版图，总分-10分；架构创新+10分，电路创新+10分。课题目标检索文献，对比实现快速稳定、低纹波稳压电路的可行方案架构；(可选但不限于pump+LDO架构）理论分析出达成课题指标的关键因素；搭建电路，仿真迭代电路各项指标，并与分析计算值对比。绘制完整版图，进行后仿真，并与前仿指标进行对比；课题输出完整的设计报告，包括电路图截图、版图截图、详细理论分析、计算结果、仿真截图、计算值仿真值对比表。赛题三片上高一致性温度传感器的设计与实现赛题背景温度传感器(temperaturesensor)是一种能感应温度，把温度转换成数字输出信号的传感器。随着芯片集成度越来越高，片上系统和应用环境越来越复杂，芯片的工作温度不再单一和可预知。为了确保芯片一直工作在最佳状态，必须实时监测芯片的工作温度，对关键参数进行实时调整。所以，在芯片上集成温度传感器成为一个重要的发展趋势。由于受到实际制造和芯片工作电压的影响，芯片和芯片之间存在差异，也就是说对于同一温度，温度传感器转换成的数字码不一致，这会导致关键参数调整存在偏差，芯片性能变差，所以如何修正温度传感器芯片和芯片之间的偏差也成为一个重要的研究课题。课题内容及要求1.完成一个完整的温度传感器原理图和版图设计，要求：（1）温度测试范围-40~120℃；（2）ADC的采样率小于1us；（3）量化精度0.5℃以上;（4）蒙特卡洛（Montecarlo）仿真3σ≤0.5℃;2.建议使用特征尺寸≤65nm的工艺设计，温度传感器的结构不限，可以是纯模拟或者数模混合电路；3.设计过程中需要包含调研、仿真建模分析、理论计算分析、电路原理图和版图绘制、后仿真分析等，并最终体现在设计报告中。评审得分点1.完成电路设计，typical仿真温度转换精度达到0.5℃；（20分）2.完成版图设计，typical仿真温度转换精度达到0.5℃；（20分）3.蒙特卡洛（Montecarlo）仿真3σ≤0.5℃（40分）4.加分项：（1）设计中出现有效的突出创新点（≤20分）（2）满足设计的条件情况下，面积和功耗同比占优的（≤20分）（3）满足Montecarlo仿真要求，校准电路自动化程度同比占优的（≤20分）课题目标1.能够分析出课题主要设计要点，完成从前期调研到后期的后仿验证全部过程，完成设计报告，报告中包含所有课题内容；2.设计结果必须功能正确，最好能够与实验室固有研究课题相结合，使面积、功耗以及精度等综合评分能够与调研结果可比；3.能够针对设计中遇到的问题，合作思考解决，设计中有一定的设计创新之处；课题输出1.设计报告，包括建模分析过程、原理图、版图截图、仿真结果等，如果有数字模块，需要附上数字代码2.给出电路的蒙特卡洛（Montecarlo）仿真结果，如有校准电路，给出校准前后的蒙特卡洛（Montecarlo）仿真对比结果3.设计中的难点解决与团队合作过程心得小结赛题四多通道多模式ADC电路设计赛题背景在安防监控、物联网、可穿戴设备等应用场景下，为实现多种信息和信号的采集，各类传感器得到广泛的使用，其中大量传感器应用在采用电池供电的移动设备中，部分应用还要求传感器长期处于工作状态（always-on），这对芯片功耗提出了严格的要求。另一方面，随着周围环境的变化，要求传感器能够在不同工作模式（如低功耗、高性能等）中进行切换。模数转换器（ADC）作为传感器中信号处理的重要电路模块，需要能够配合系统需求，在低功耗、高精度、高速等多模式中进行切换。另外，传感器通常需要在一定时间内完成多通道数据的处理，以图像传感器为例，通常要求在一行像素的读出时间内完成当前行所有像素的量化，这需要实现相应的多通道ADC电路（如并行的ADC阵列）。课题内容及要求1.设计一款多通道多模式ADC，完成电路及版图设计。2.ADC（阵列）支持1000个通道的数据处理，所有通道的输入均为低频电压信号，电压范围1~2V。3.各模式说明：常规模式，转换时间2us，ENOB不低于10bit；低功耗模式，转换时间4us，ENOB不低于8bit，功耗越低越好；高精度模式，转换时间2us，ENOB不低于13bit，精度越高越好；高速模式，转换时间1us，ENOB不低于10bit，速度越快越好。至少支持常规模式和低功耗模式，其余模式（包括但不限于以上模式）为加分项。4.假定信号为Y方向输入，则ADC主体电路版图在X方向总长度≤3000um（单通道≤3um），Y方向长度不限。5.建议使用特征尺寸≤65nm的工艺设计。评审得分点1.基础得分项：1.1电路功能及指标（50）：达到常规及低功耗两种模式要求，以综合考虑各指标的FoM值作为总体评价指标。1.2设计及仿真分析报告（30）：完整的设计及仿真分析报告，需要完成电路后仿真。1.3版图设计（10）：满足课题要求，总面积尽量小。1.4不同通道之间数据转换的一致性（10）2.加分项：2.1支持更多种模式（20）2.2设计的新颖性（10）课题目标1.能够分析出课题主要设计要点，完成从前期调研到后期的后仿验证全部过程，完成设计报告，报告中包含所有课题内容；2.设计结果必须功能正确，最好能够与实验室固有研究课题相结合，使面积、功耗以及速度性能综合评分能够与调研结果可比；3.能够针对设计中遇到的问题，合作思考解决，设计中有一定的设计创新之处。课题输出1.设计报告，包括调研分析、原理图、版图、仿真结果等。2.设计中的难点解决与团队合作过程心得小结。赛题五片上高速接口电路设计与实现赛题背景高速接口电路是许多高集成度芯片的主要输入/输出形式，在芯片之间以几百Mbps到几十Gbps的速度传输串行数据，可以快速高效地实现芯片之间的数据通信，在图像、显示、存储等需要大规模数据交互的应用中已经成为必不可少的电路模块。完整的高速接口电路通常包括发送端、传输路径、接收端三个部分组成，三个部分需要在协议和电气特性上保证一定的一致性和匹配性。高速接口传输的实现方式是多样的，常见的包括差分输出（LVDS,CML,MIPID-PHY），三态输出(MIPIC-PHY)，PAM4输出，不同的输出形式其电路结构和特性也存在一些差异。在图像传感器芯片应用中，高速接口电路的设计受到工艺、功耗和面积等因素的限制，同时需要考虑ESDEMI/EMC等性能可靠性问题，使得高速接口电路的设计成为产品升级过程中的一个重要技术突破点。课题内容及要求1.完成一个单lane输出的高速Serdes发送端电路的原理图和版图设计，要求等效输出速率大于等于8Gbps（TT工艺下后仿真结果）;2.建议使用特征尺寸≤65nm的工艺设计，限制版图可用金属层数为M1~M44层金属；3.设计中只有一个理想时钟源（频率自定），需要设计时钟处理电路产生发送端电路中用到的所有不同频率、不同相位的时钟信号；4.需要设计均衡电路（预加重/去加重），分别给出不带路径负载模型和带路径负载模型的输出信号波形，并分别给出存在路径负载模型的情况下开关均衡电路时的输出波形；5.对输出信号波形进行眼图叠加和抖动分析，说明抖动来源。评审得分点1.同等设计平台下，版图面积越小越好，功耗越小越好，工作速度上限越高越好；2.仿真结果一定是后仿真结果，如果只有前仿真结果会进行适当减分，仿真时需要在输出加上PAD封装等效负载模型；3.版图绘制超过4层金属会进行适当减分；4.设计中出现有效的突出创新点可加分，若设计工艺条件有限制，可适当降低TX电路的工作速率要求，但相应的得分也会降低。课题目标1.能够分析出课题主要设计要点，完成从前期调研到后期的后仿验证全部过程，完成设计报告，报告中包含所有课题内容；2.设计结果必须功能正确，最好能够与实验室固有研究课题相结合，使面积、功耗以及速度性能综合评分能够与调研结果可比；3.能够针对设计中遇到的问题，合作思考解决，设计中有一定的设计创新之处；4.不限输出形式，不局限于差分结构的输出，传输路径负载模型可以自己模拟搭建或者在网上查找下载。课题输出1.设计报告，包括调研分析、原理图、版图截图、功能和功耗仿真等（75%+附加分10%：原理图15%，版图20%，时钟方案选择5%，功能正确速度达到要求10%，预加重/去加重功能及仿真结果15%，带负载模型仿真对比10%，附加分：电路架构、版图面积、工艺、功耗、速度上限评估优异加分1~10%）2.输出眼图和抖动仿真结果与分析报告（15%）3.设计中的难点解决与团队合作过程心得小结（10%）

Cadence企业命题专项奖设置一等奖一队，奖金10000元二等奖三队，奖金5000元三维集成电路的多层模块划分最优化算法背景一个数字电路的Verilog网表通常由多个模块（module）组成。模块内部的逻辑单元、寄存器之间有大量的连接。模块和模块之间也互相有信号的连接。当设计者在早期规划芯片的布图结构(Floorplan）的阶段，通常可以先忽略模块内部的连接，而更关注模块之间的连接关系。这样可以在不损失太多精度的同时，更快速地评估架构的可行性。同时我们也需要考虑各个模块的面积（通常由该模块内部instance的总面积决定），使得这些模块在后端实现的布局布线阶段，能够在芯片的版图上得到合理的面积分配。此处为了简化问题的形式，我们暂时忽略整个芯片对外的输入输出（I/O)而只考虑模块之间的连接。例如，图1是拥有7个模块（Verilogmodule，非hardIPblock）的一个芯片。模块有不同大小的面积。模块之间的连接用线段表示，线段上的数字代表了连接的信号个数。图1:模块大小和连接关系的例子三维集成电路与模块划分用三维集成电路来实现一个芯片，会遇到的一个常见问题是：如何对整个芯片的电路模块进行划分，使这些模块被分配到多个裸片（Die）上。下图是一个把电路划分成两部分，并分配到上下两个同样面积的裸片上的例子。划分之后，两部分电路之间的连接，通过裸片之间的堆叠工艺实现，比如常见的有Bump以及TSV（ThroughSiliconVia）。图2:划分到两个裸片的例子关于TSVTSV提供了信号穿越裸片衬底的通路。但是它自身也需要占据一部分面积，因此也必须考虑到TSV带来的额外的面积需求。图3:TSV示例当多层裸片堆叠时，凡裸片和裸片界面处穿过衬底的地方需要TSV。图4:多层裸片间的TSV关于Feedthrough当多层裸片堆叠时，比方说3层：从第一层到第三层的信号连接，即使在逻辑上并没有和第二层的模块有任何关系，物理上也必须穿过第二层，即Feedthrough。从而有可能会产生额外的TSV。图5:Feedthrough约束条件三维划分需要考虑的硬性约束条件有：1.一个裸片上所有模块的总面积，加上这个裸片上所需的TSV的总面积，不能超过裸片的面积，即面积利用率不能超过100%。2.相邻两个裸片的界面上，可容纳的Bump/TSV的数量是有上限的。约束条件的例子下图是面积约束条件的一个例子（假设每根线代表100个信号）：如果不考虑面积，左边的划分是最好的，因为只需要200个bump。但是第一层的模块总面积已经超过了裸片面积。此时采用右边的方案，bump数量增加到了500个，但只要仍然小于两个die之间所能容纳bump数量的上限，同时模块总面积也并没有超过裸片面积，则仍然是可行的。题目要求对于主办方给定的：模块连接图（包含模块面积以及连接关系和信号数量）裸片尺寸、TSV单位尺寸相邻两个Die之间的Bump/TSV数量上限（为简化题目，假设Bump和TSV的数量上限相同附件下载链接：http://cpipc.acge.org.cn/sysFile/downFile.do?fileId=9858fd164ecd47ae9fa8ac5d767e1304要求把所有模块划分到3个裸片上。不考虑整个芯片对外的I/O。堆叠方向如图所示，灰色表示衬底：图7:堆叠方向在满足硬性约束条件下，最优化以下两个目标：1.3个裸片上模块的面积利用率尽可能相同。避免出现有些裸片过于拥挤而有些裸片大片空白的情况。利用率=（模块总面积+TSV总面积）÷裸片面积2.裸片间bump/TSV数量尽可能少。附加题——考虑模块布局与总线长基本题并不考虑模块在版图上的具体位置，只计算其面积和连接数。附加题要求提出一种算法并尝试实现：在考虑模块布局（无缝铺满整个裸片区域，形状可以是矩形或直角多边形，如图8所示）的前提下，使总线长最短。注1：由于利用率总是小于100%，因此铺满后每个模块的占地面积将大于它的初始面积。但不可小于初始面积。注2：总线长的计算用模块几何中心之间的水平距离来简化。注3：TSV假设均布在裸片上，可先不考虑其具体位置，但面积需算入。图8:模块布局与总线长提交要求：1.PPT报告，2.优化算法代码，3.可重现的计算结果

答疑邮箱：wangbo24@hisilicon.com华为企业命题专项奖设置特等奖：2队，每队奖金1万+1万元华为产品一等奖：5队，每队奖金1万二等奖：12队，每队奖金0.5万华为赛题总参赛队低于30队时，将适当减少获奖名额赛题一：12GbpsNRZ接收机均衡器（RXEQ）设计描述及要求（基础）：1.设计一个满足性能要求的工作速率12Gbps的接收机均衡器电路；2.发射机输出幅度差分400mV；3.信道插入损耗IL>10dB@6GHz，SP参数见附件；下载链接：cpipc.acge.org.cn/sysFile/downFile.do?fileId=2bad6f2dc7a644a0938300e0e2c9ef6a4.信道编码：NRZ，码型：PRBS7；5.接收机均衡器输出指标：jitter<0.2UI;6.CTLE功耗电流要求<15mA;7.具有信道线性均衡（CTLE）能力；8.给出均衡器和输出波形和眼图（前仿真结果）；9.完成版图和后仿真；描述及要求（加分）：1.Jitter<0.15UI，越小越好；2.CTLE工作电流<10mA，越小越好3.具有判决反馈均衡（DFE）能力；4.具有自适应线性均衡算法能力（算法和设计可以分开）；5.具有自适应判决反馈均衡能力（算法和设计可以分开）；评审得分点：1.电路原理正确，能完成正常的均衡功能和前后仿真结果；2.功耗，面积有合理分析；3.Jitter指标越小，得分越高；4.功耗越小，得分越高；5.低阶工艺设计是加分项；6.有DFE和自适应均衡算法和实现是加分项；输出要求：1.接收机系统设计思路。2.电路原理图和Verilog代码以及版图。3.仿真结果（前仿，后仿）。4.总结：方案优势，不足，改进建议等。赛题二：超低噪声、超高PSRR的LDO芯片设计描述及要求：1.超低RMS噪声:8µVRMS(10Hzto100kHz)2.超低噪声功率谱密度:20nV/√Hz@10kHz3.超高电源纹波抑制比（PSRR）:70dB@1MHz4.最大输出电流:50mA5.宽输入电压范围:5V+/-10%；6.可使用一个外接电容（非输出电容）以提升Noise和PSRR性能；7.过流保护电流限100mA；8.输出电压范围:2.5V（精度越高越好）9.瞬态响应：最大过冲/最低跌落≤±40mV@1mA和50mA在1us变化,Vin=5V,Vout=2.5V;恢复时间≤40us；10.建议使用标准CMOS工艺评审得分点：1.思路正确，没有大的Bug；2.噪声、PSRR、瞬态响应等关键性能指标越高，得分越高；3.需要有文档，说明各个子电路性能指标（如基准源，误差放大器，快速启动控制，全环路控制）的分解依据，子电路结构的选择依据等；4.查询业界典型产品的指标，分析差距存在的原因，和可能的改进方向；5.面积、功耗有合理分析；6.各个子模块的功耗和噪声贡献（用饼状图给出占比分析）；7.PSRR性能分析；8.瞬态响应性能分析；输出要求：1.电路及仿真设置；2.详细设计文档；3.电路原理图与仿真验证数据。赛题三：16bit/5Msps的SARADC设计描述及要求：1.样本率：5MSPS2.分辨率：16位，无丢码3.动态范围：>=80dB4.信噪比(SNR)：>=80dB5.总谐波失真(THD)：−90dB6.积分非线性(INL)：±6LSB(典型值)7.差分非线性(DNL)：±0.5LSB(典型值)8.真差分模拟输入电压范围：±5V9.低功耗：小于100mW(5MSPS，外部基准电压缓冲器，回波时钟模式)10.SAR架构无延迟/流水线延迟11.温度范围：−40°C至+125°C12.供电电压：5V或者3.3V（模拟部分），不限（数字部分）13.工艺：CMOS工艺评审得分点：1.思路正确，没有大的Bug。2.SNR等关键性能指标越高，得分越高。3.需要有文档，说明各个子电路性能指标（如Vref，高速比较器，充放电电容阵列）的分解依据，子电路结构的选择依据等。4.查询业界典型产品的指标，分析差距存在的原因，和可能的改进方向。5.面积、功耗有合理分析。6.各个子模块的噪声贡献（用饼状图给出占比分析）。7.各个子模块的功耗（用饼状图给出占比分析）。8.非线性校正算法的选择。输出要求：1.系统级模型或直接电路模型。2.详细设计文档。3.电路原理图与仿真验证数据。赛题四：基于AI的侧信道数据分析描述及要求：1.数据分：SET1训练数据集合（Label、data）、SET2测试数据集合（Label、data）。曲线参考见赛题四附件。下载链接：cpipc.acge.org.cn/sysFile/downFile.do?fileId=4c49e2866ccc40a6bd6e25c964d77bea2.使用基于AI进行侧信道数据进行分析测试：使用数据集Set1进行训练，Set2进行攻击匹配测试；3.基于AI侧信道测试方式不少于2种（CNN、MLP等）；4.训练曲线数目无要求，最高不超过Set1最大数目，攻击测试曲线要求对Set2全部进行测试，目标：利用训练的模板对Set2进行label测试匹配，成功率=匹配成功曲线数目/全部测试曲线数目；5.AI模型要求硬件实现（实现方式不限），同时有软件代码做参考rm对硬件进行正确性验证。评审得分点：1.相同测试曲线数目，成功率越高得分越高；2.两种方式最终得分：(方式1成功率+方式2成功率)/2；3.有第三种及以上基于AI攻击方式，作为加分项。输出要求：1.攻击算法的设计文档、实现代码以及实验数据（不含原始曲线数据）；2.不同AI侧信道分析方式的比较分析文档；赛题五：基于指令集的后量子格密码设计描述及要求：1.使用verilog采用指令集方式（协处理器方式）搭建NIST第三轮数字签名候选算法CRYSTALS-Dilithium（NISTSecurityLevel=2），其中综合频率不低于200MHz（28nm），密钥生成、签名和验签阶段的cycle数分别不超过9k,54k和9k，逻辑门（不含memory）面积不超过400K门。2.格基算法中采样器和多项式乘法算子要求硬件逻辑实现，其中采样器至少支持离散高斯采样和二项分布采样。评审得分点：1.功能正确，符合题目要求。2.算法CRYSTALS-Dilithium实现的面积越小，功耗越低，综合频率越高，得分越高3.指令集可扩展性越强（可搭建除CRYSTALS-Dilithium之外的格基密码算法，如CRYSTALS-Kyber，Saber等），得分越高。4.指令集设计中考虑防侧信道和故障注入攻击，可加分。5.在性能、逻辑门面积相同条件下，Memory面积越小得分越高。输出要求：CRYSTALS-Dilithium算法的详细设计文档（包括专用指令集的功能和结构描述）、逻辑代码、性能报告和验证报告。赛题六：电磁特征识别算法设计描述及要求1.在EM侧信道和EM故障注入中，被测目标载体是一个比较大的目标例如（3cm*3cm）,2.探头直径只有0.2mm,0.5mm.待测目标运算所占面积和探头面积相当（目标运算为一个黑盒，可以进行已知数据输入、输出结果获取）；3.在EM侧信道攻击测试中，如何以最优的方式快速选择最佳侧信道采集点4.（泄露最明显位置），选择方式需要优于穷举法，并进行对比说明；5.在EM故障注入时，如何以最优的方式快速选择最佳故障注入点6.（故障注入最易出错位置），选择方式需要优于穷举法，并进行对比说明；7.并通过实际测试或仿真方式验证选取方式。评审得分点：1.理论分析越全面，得分越高；2.在FPGA、Asic平台上推广性越高越好；3.与穷举法对比说明理论清晰，结论越合理越全面得分越高；输出要求：1.最佳探测点识别选取算法的设计文档、实现代码以及实验数据；2.不同电磁检测点选取方式的理论分析文档；3.不同电磁检测点选取方式算法分析文档和实现代码；赛题七：高性能ONLINEDATACRYPTO模块设计描述及要求：1.基于标准加密算法设计一个加解密模块IP，通过该模块IP，SOC对总线传输及存入存储的数据进行机密性和防重放的保护；2.高性能ONLINEDATACRYPTO模块可以选择NIST、IEEE、IETF等组织颁布的标准加密算法（包括候选算法），但不包含AES，SM4算法，算法模式不限；3.采用Verilog实现高性能ONLINEDATACRYPTO模块，采用SMIC40nm工艺时，工作时钟频率300MHz以上，性能为128bit/cycle，采用其他工艺时，频率需要等比例折算；4.高性能ONLINEDATACRYPTO模块接口请参考AXI接口，接口如下图所示，实际接口信号可根据具体实现进行增减。AXI通道中AW通道，AR通道和B通道无需处理，因此接口中未画出其输出接口。5.AXI写操作不支持乱序和间插，AXI读操作支持乱序和间插。评审得分点：1.实现算法功能正确，满足题目要求；2.设计方案文档描述清晰，模块功能划分合理；3.代码简洁，可维护性好；4.模块加密安全性证明越合理，安全性越高，得分越高；5.文档中要求明确的对面积和功耗优化的措施说明，优化措施越有效，模块面积越小，功耗越低，得分越高；6.对数据吞吐量影响越小，读写latency越小，得分越高；7.要求有完备的验证方案和验证用例；输出要求：1.详细设计文档和逻辑代码；2.输出验证用例、验证数据和波形截图；3.功能、性能仿真报告以及功耗/性能/面积评估数据。赛题打分原则：90分及以上：满足题目所有要求，有较好的商业价值或有较多亮点（亮点定义为架构清晰、算法效率高、实现指标优异等任何超出题目要求的点），PPA、设计指标等行业领先。75-89分：满足题目所有要求，同时有一定的商业价值或有一定亮点。亮点越多得分越高。60-74分：满足大多数要求或题目全部要求，作品整体上中规中距无亮点。60分以下：不满足题目大多数要求。建议在作品中列举作品的亮点和不足。满足题目要求的基础上，超出题目要求越多越好。

京微齐力企业命题专项奖设置：一等奖1队，奖金10000元二等奖3队，奖金5000元京微齐力企业命题答疑邮箱：yunqin.li@hercules-micro.com赛题一：可编程边缘计算加速器命题说明：基于京微齐力提供的P1EVB开发板，使用P1器件内DSP、RAM和可编程逻辑资源实现FPGA方案的硬件加速。硬件加速的应用方向可以是人工智能、图像处理、语音处理、激光雷达、毫米波雷达、信号采集与处理，软件无线电、电机控制等场景。京微齐力提供RISC-V软核系统，参赛队伍也可以使用第三方的软核或硬核CPU或MCU系统，通过SPI、并口、串口或其他接口实现与P1EVB板的通信与控制。软核或硬核CPU主要用于实现人机交互、可编程加速系统的参数配置、部分算法的软件调度、状态与最终结果显示。注意：请务必使用京微齐力P1器件实现应用算法的加速，部分算法调度，实时性不高的算法可在软核或硬核CPU上软件实现。京微齐力P1器件的可编程资源：60K等效LC资源144个DSP单元；144个18KbBRAM单元硬核800Mbps的DRR3x16的硬核DDR3控制器，接口是128位的AXI接口支持1.2-3.3V单端GPIO；LVDS，MIPI，HDMI接口的高速差分GPIO京微齐力P1器件开发的软硬件资源：借用P1EVB开发板1块；如需扩展子卡需要从京微齐力合作伙伴米联客进行单独购买提供京微齐力FPGA开发工具Fuxi提供基于AXI接口DDR3的参考设计提供软核RISC-V的参考设计和使用文档，如需RISC-V在线调试工具需自行购买；京微齐力P1开发板的简介：HDMI输出接口1个，支持720P60，提供参考设计DDR3x16颗粒，容量2Gb，提供800Mbps速率的参考设计2路CEP扩展接口，2.54mm间距排针1路1000M以太网USB-UART接口，TF卡座；4个按键；5个LED指示灯；25Mhz有源晶振EVB原理图摄像头扩展接口2个，提供摄像头驱动和参考设计；摄像头模块需要从京微齐力合作伙伴米联客单独购买2路FEP扩展接口，48个GPIO/24个差分对，可对接京微齐力合作伙伴米联客各种扩展卡：ADC扩展卡，DAC扩展卡，LCD扩展卡，音频卡，USB3.0卡，HDMI视频输入输出卡，MIPI摄像头卡等，提供相关的参考设计；扩展子卡需要单独购买作品输出要求：设计报告作品PPT详细方案介绍与分析设计报告：作品实现关键算法加速部分的原理，特点，技术优势，功能仿真，关键接口或波形的说明，测试结果分析等作品视频与图片展示设计数据项目系统框图，PCB原理图，扩展子板或飞线原理图软件和硬件设计源代码仿真和测试结果，关键算法部分提供RTL仿真激励，仿真结果与波形数据更佳评分标准备注：关于开发板：开发板数量充足，可满足赛事需求。考虑到为避免资源浪费，我们会直接免费借用10块板给相关参赛队伍，超过10块板之后需通过申请流程，经评估后可免费借于参赛队伍使用。申请开发板请发邮件至：yunqin.li@hercules-micro.com赛题二：基于AXI总线接口的二级Cache设计命题说明及作品要求：设计一个二级Cache，需要支持以下特性：支持读写两种Cache操作；支持三个接口：两个axislave接口，一个aximaster接口：1、axislave接口负责Cache空间访问；2、aximaster接口为主存空间访问；支持32Kbyte地址空间映射到最大256MB连续空间；支持两个axislave接口同时访问不同的cacheline；Cacheline支持32byte；写操作支持写回和写穿两种模式；支持四路组相联；支持读操作分配和写操作分配；Cache替换支持两种替换算法：1、将最近最少使用的内容替换出Cache；2、将访问次数最少的内容替换出Cache；支持clear操作；支持flush操作；内嵌静态SRAM；FPGA验证支持100MHz；ASIC流程支持工作频率能够达到500MHz;备注：1.关于学生搭建仿真模型：我们可以提供sram仿真模型，学生也可以通过给定的仿真时序搭建。2.推荐使用米联客P1开发板，FPGA原型验证（频率为100MHz）。3.我们会提供testcase列表，作为必要的仿真用例。AXI_mem_m为aximaster接口，AXI_mem_s为axislave接口，数据位宽为32bit，支持标准AXI协议。提交文件：1.详细设计方案；2.RTL代码；3.仿真测试用例；评分标准注：如果以上分数相同，则以资源使用最少者获胜。答疑邮箱：yunqin.li@hercules-micro.com